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// The OS/K Team licenses this file to you under the MIT license.
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// See the LICENSE file in the project root for more information.
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#include <pc/device.h>
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reg_t arch_r[] =
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{
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{ "inv", RES }, { "flg", GPR }, { "rip", GPR }, { "rpc", GPR },
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{ "px0", RES }, { "px1", RES }, { "fc1", RES }, { "fc2", RES },
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{ "sa0", SYS }, { "sa1", SYS }, { "sa2", SYS }, { "sa3", SYS },
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{ "cr0", SYS }, { "cr1", SYS }, { "cr2", SYS }, { "cr3", SYS },
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{ "rax", GPR }, { "rbx", GPR }, { "rcx", GPR }, { "rdx", GPR },
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{ "rsi", GPR }, { "rdi", GPR }, { "rbp", GPR }, { "rsp", GPR },
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|
{ "rx8", GPR }, { "rx9", GPR }, { "r10", GPR }, { "r11", GPR },
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{ "r12", GPR }, { "r13", GPR }, { "r14", GPR }, { "r15", GPR },
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{ "ax0", GPR }, { "ax1", GPR }, { "ax2", GPR }, { "ax3", GPR },
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{ "ax4", GPR }, { "ax5", GPR }, { "ax6", GPR }, { "ax7", GPR },
|
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{ "ax8", GPR }, { "ax9", GPR }, { "a10", GPR }, { "a11", GPR },
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{ "a12", GPR }, { "a13", GPR }, { "a14", GPR }, { "a15", GPR },
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{ "nx0", GPR }, { "nx1", GPR }, { "nx2", GPR }, { "nx3", GPR },
|
|
{ "nx4", GPR }, { "nx5", GPR }, { "nx6", GPR }, { "nx7", GPR },
|
|
{ "nx8", GPR }, { "nx9", GPR }, { "n10", GPR }, { "n11", GPR },
|
|
{ "n12", GPR }, { "n13", GPR }, { "n14", GPR }, { "n15", GPR },
|
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// { "dr0", SYS }, { "dr1", SYS }, { "dr2", SYS }, { "dr3", SYS },
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// { "sa4", SYS }, { "sa5", SYS }, { "sa6", SYS }, { "sa7", SYS },
|
|
// { "dr4", SYS }, { "dr5", SYS }, { "dr6", SYS }, { "dr7", SYS },
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// { "cr4", CTL }, { "cr5", CTL }, { "cr6", CTL }, { "cr7", CTL },
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/*
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{ "r16", GPR }, { "r17", GPR }, { "r18", GPR }, { "r19", GPR },
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{ "r20", GPR }, { "r21", GPR }, { "r22", GPR }, { "r23", GPR },
|
|
{ "r24", GPR }, { "r25", GPR }, { "r26", GPR }, { "r27", GPR },
|
|
{ "r28", GPR }, { "r29", GPR }, { "r30", GPR }, { "r31", GPR },
|
|
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{ "a16", GPR }, { "a17", GPR }, { "a18", GPR }, { "a19", GPR },
|
|
{ "a20", GPR }, { "a21", GPR }, { "a22", GPR }, { "a23", GPR },
|
|
{ "a24", GPR }, { "a25", GPR }, { "a26", GPR }, { "a27", GPR },
|
|
{ "a28", GPR }, { "a29", GPR }, { "a30", GPR }, { "a31", GPR },
|
|
|
|
{ "n16", GPR }, { "n17", GPR }, { "n18", GPR }, { "n19", GPR },
|
|
{ "n20", GPR }, { "n21", GPR }, { "n22", GPR }, { "n23", GPR },
|
|
{ "n24", GPR }, { "n25", GPR }, { "n26", GPR }, { "n27", GPR },
|
|
{ "n28", GPR }, { "n29", GPR }, { "n30", GPR }, { "n31", GPR },
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|
*/
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};
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static_assert(NREGS <= 256, "");
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static_assert(sizeof(arch_r)/sizeof(reg_t) == NREGS, "");
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#define DUMPREGS(down, up) \
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for (i = down; i <= up; i++) { \
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if (i % 4 == 0) \
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trace("\n"); \
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r = &ctx->r[i]; \
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trace("%s=0x%-16lX ", r->name, R(i)); \
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} \
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void dumpregs(ctx_t *ctx)
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{
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int i;
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reg_t *r;
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trace("Current RFRAME index: #%lu\n", rfs_current_idx);
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DUMPREGS(RAX, R15);
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trace("\n");
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DUMPREGS(AX0, A15);
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trace("\n");
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DUMPREGS(NX0, N15);
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trace("\n");
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DUMPREGS(SA0, SA3);
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DUMPREGS(CR0, CR3);
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trace("\n\nrip=0x%-16lX rpc=0x%-16lX rsp=0x%-16lX rbp=0x%-16lX",
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rip, rpc, rsp, rbp);
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trace("\nfc0=0d%-16lu fc1=0d%-16lu fc2=0d%-16lu flg=0x%-16lX\n",
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|
fc0, fc1, fc2, flg);
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|
/*
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trace("\nCF=%x OF=%x\n"
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|
"ZF=%x SF=%x\n"
|
|
"PF=%x DF=%x\n"
|
|
"IF=%x UF=%x\n",
|
|
!!(flg&CF), !!(flg&OF),
|
|
!!(flg&ZF), !!(flg&SF),
|
|
!!(flg&PF), !!(flg&DF),
|
|
!!(cr0&IF), !!(cr0&UF));
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|
*/
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assert(inv == 0);
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|
}
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