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// The OS/K Team licenses this file to you under the MIT license.
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// See the LICENSE file in the project root for more information.
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#include <pc/arch.h>
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reg_t arch_r[NREGS] =
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{
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// Invalid register
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{ "inv", 0, RES },
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// Instruction pointer
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{ "rip", 0, RES },
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// Flags register
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{ "flg", 0, RES },
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// Stack registers
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{ "rbp", 0, GPR },
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{ "rsp", 0, GPR },
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// Reserved registers
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{ "rx0", 0, RES },
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{ "rx1", 0, RES },
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{ "rx2", 0, RES },
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// General-purpose volatile registers
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{ "rax", 0, GPR },
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{ "rbx", 0, GPR },
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{ "rcx", 0, GPR },
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{ "rdx", 0, GPR },
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|
{ "rsx", 0, GPR },
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{ "rbi", 0, GPR },
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{ "rdi", 0, GPR },
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{ "rsi", 0, GPR },
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// General-purpose non-volatile registers
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{ "nx0", 0, GPR },
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{ "nx1", 0, GPR },
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{ "nx2", 0, GPR },
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|
{ "nx3", 0, GPR },
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|
{ "nx4", 0, GPR },
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|
{ "nx5", 0, GPR },
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|
{ "nx6", 0, GPR },
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|
{ "nx7", 0, GPR },
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// Argument registers; volatile
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{ "ax0", 0, GPR },
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{ "ax1", 0, GPR },
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{ "ax2", 0, GPR },
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|
{ "ax3", 0, GPR },
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|
{ "ax4", 0, GPR },
|
|
{ "ax5", 0, GPR },
|
|
{ "ax6", 0, GPR },
|
|
{ "ax7", 0, GPR },
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// Leaf function registers; volatile
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{ "lx0", 0, GPR },
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{ "lx1", 0, GPR },
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{ "lx2", 0, GPR },
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|
{ "lx3", 0, GPR },
|
|
{ "lx4", 0, GPR },
|
|
{ "lx5", 0, GPR },
|
|
{ "lx6", 0, GPR },
|
|
{ "lx7", 0, GPR },
|
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// Control register
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{ "cr0", 0, CTL },
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{ "cr1", 0, CTL },
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|
{ "cr2", 0, CTL },
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|
{ "cr3", 0, CTL },
|
|
{ "cr4", 0, CTL },
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|
{ "cr5", 0, CTL },
|
|
{ "cr6", 0, CTL },
|
|
{ "cr7", 0, CTL },
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// System-reserved
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{ "sa0", 0, SYS },
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|
{ "sa1", 0, SYS },
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|
{ "sa2", 0, SYS },
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|
{ "sa3", 0, SYS },
|
|
{ "sa4", 0, SYS },
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|
{ "sa5", 0, SYS },
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|
{ "sa6", 0, SYS },
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|
{ "sa7", 0, SYS },
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|
};
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#define DUMPREGS(down, up) \
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for (i = down; i <= up; i++) { \
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if (i % 4 == 0) \
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log("\n"); \
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r = &ctx->r[i]; \
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log("%s=0x%-16lX ", r->name, r->val); \
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} \
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void dumpregs(ctx_t *ctx)
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{
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int i;
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reg_t *r;
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assert(inv == 0);
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DUMPREGS(RAX, RSI);
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DUMPREGS(AX0, AX3);
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DUMPREGS(LX0, LX3);
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log("\n");
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DUMPREGS(NX0, NX3);
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DUMPREGS(SA0, SA3);
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DUMPREGS(CR0, CR3);
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log("\n\nrip=0x%-16lX rsp=0x%-16lX rbp=0x%-16lX flg=0x%-16lX\n\n",
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rip, rsp, rbp, flg);
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log("CF=%x OF=%x\n"
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"ZF=%x SF=%x\n"
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"PF=%x DF=%x\n"
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"IF=%x UF=%x\n",
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!!(flg&CF), !!(flg&OF),
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|
!!(flg&ZF), !!(flg&SF),
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|
!!(flg&PF), !!(flg&DF),
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|
!!(flg&IF), !!(cr0&UF));
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}
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